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基于FPGA的VRLA蓄电池测试系统设计
作者: 发布时间:2007-10-27 11:20:28 来源: 繁体版
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  D12_MODE_CONFIG,                                  //发送模式设置

  D12_MODE_CLOCK_DIV,                               //发送分频率模式

    others => X"00" );

  constant D12_CONNECT_DATA_TYPE: REG8x1:=             //命令、数据执行顺序

  ( D12_COMMAND,

  D12_DATA,                                          //发送数据

  D12_COMMAND,

  D12_DATA,                       //发送数据

  others => '0' ); 

  constant D12_CONNECT_DATA_LENGTH: INTEGER8 := 5;     //配置参数总长度

  constant D12_EP0_ACK_DATA: REG8x8:=                  //配置0断点命令

  (   D12_COMMAND_SEL_EP0_OUT,                  &nb sp;     //发送0断点选择

      D12_COMMAND_ACK_SETUP,                          //确认建立

      D12_COMMAND_CLEAR_EP_BUFFER,                    //清寄存器

      D12_COMMAND_SEL_EP0_IN,                         //接收0断点选择

      D12_COMMAND_ACK_SETUP,                          //确认建立

      others => X"00"  );

  constant D12_EP0_ACK_DATA_LENGTH: INTEGER8 := 5;    //配置0断点总长度

  constant ep0_ack_data: REG8x8 := D12_EP0_ACK_DATA;  //发送0断点数据                   

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基于FPGA的DS/CDMA解扩解调模块设计与实现
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